跟 PCIe 5.0 相比，PCIe 6.0 主要有以下变化：
单 Lane 传输速率由 32 GT/s 变为 64 GT/s；
传输信号由 NRZ 两电平变为 PAM4 四电平；
编码方式由 128b/130b 变为 FLIT 编码；
引入了 FEC 前向纠错机制，并维持既有的 Retry 重传机制；
LTSSM 新增加了 L0p 低功耗状态，允许部分 Lane Electric Idle、部分 Lane Active；
新加了几种机制：DOE、CMA、DMWr、IDE。
PCIe5.0技术更新及PCIe6.0技术展望
PCIe GEN5 GEN6 overview
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